Exploiting processor features to implement error detection in reduced precision matrix multiplications

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Revista:
Microprocessors and Microsystems

ISSN: 0141-9331

Año de publicación: 2014

Volumen: 38

Número: 6

Páginas: 581-584

Tipo: Artículo

DOI: 10.1016/J.MICPRO.2014.05.001 GOOGLE SCHOLAR