A scheme to reduce the number of parity check bits in orthogonal Latin square codes

  1. Reviriego, P.
  2. Liu, S.
  3. Sánchez-Macián, A.
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  5. Maestro, J.A.
Zeitschrift:
IEEE Transactions on Reliability

ISSN: 0018-9529

Datum der Publikation: 2017

Ausgabe: 66

Nummer: 2

Seiten: 518-528

Art: Artikel

DOI: 10.1109/TR.2017.2669090 GOOGLE SCHOLAR
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