Simplified trellis min-max decoder architecture for nonbinary low-density parity-check codes

  1. Lacruz, J.O.
  2. Garcia-Herrero, F.
  3. Declercq, D.
  4. Valls, J.
Revista:
IEEE Transactions on Very Large Scale Integration (VLSI) Systems

ISSN: 1063-8210

Año de publicación: 2015

Volumen: 23

Número: 9

Páginas: 1783-1792

Tipo: Artículo

DOI: 10.1109/TVLSI.2014.2344113 GOOGLE SCHOLAR
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