A Scheme to Design Concurrent Error Detection Techniques for the Fast Fourier Transform Implemented in SRAM-Based FPGAs

  1. Gonzalez-Toral, R.
  2. Reviriego, P.
  3. Maestro, J.A.
  4. Gao, Z.
Revista:
IEEE Transactions on Computers

ISSN: 1557-9956,  0018-9340

Año de publicación: 2018

Volumen: 67

Número: 7

Páginas: 1039-1045

Tipo: Artículo

DOI: 10.1109/TC.2018.2792445 GOOGLE SCHOLAR
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